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标题: SDRAM接口时序和PCB布线长度的分析 [打印本页]

作者: admin 时间: 2014-10-12 14:52
标题: SDRAM接口时序和PCB布线长度的分析
引言
经常看到有文章介绍对SDRAM布线的各种要求，这只是工程上的经验总结，不同的芯片对时序的要求不同，对走线也有不同的要求，不能一概而论。其实，等长不是目的，真正的目的是满足芯片的建立保持时间，采样正确。由于FR4中的走线的传播延时近似值为6英寸/ns，根据时序关系可以转化为PCB Layout(印制板布局)的走线线长关系。

因为触发器内部数据的形成是需要一定的时间的，如果不满足建立和保持时间，触发器将进入亚稳态，进入亚稳态后触发器的输出将不稳定，在0和1之间变化，这时需要经过一个恢复时间，其输出才能稳定，但稳定后的值还不一定是你的输入值。所以为了保证接口数据传输正确，必须满足其建立保持时间。

建立时间：触发器在时钟沿来到前，其数据输入端的数据必须保持不变的时间。

保持时间：触发器在时钟沿来到后，其数据输入端的数据必须保持不变的时间。见图1。

SDRAM接口时序和PCB布线长度的分析.part1.rar
SDRAM接口时序和PCB布线长度的分析.part2.rar

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