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标题: 基于FPGA设计航空电子系统 [打印本页]

作者: liyf 时间: 2012-1-16 19:14
标题: 基于FPGA设计航空电子系统

? 基于现场可编程门阵列 (FPGA) 核心的实施体现了先进的现代航空电子设计方法。这项技术具有多种优势,如废弃组件管理、降低设计风险、提高集成度、减小体积、降低功耗和提高故障平均间隔时间(MTBF)等,吸引着用户将原来的系统转移到此项技术。MIL-STD-1553 的市场可能随着这种趋势而繁荣起来 ;事实上,某些客户已经觉得这项技术的实施有点姗姗来迟。

　　MIL-STD-1553 核心带来了多种好处,它代表着彻底告别了 ASIC 传统。FPGA 中加入一项知识产权核心,就获得了一种与众不同的特性,而成为一个非常专业的高级子系统。这为增强 MIL-STD-1553 的设计提供了千载难逢的机会。

　　系统设计面临的问题

　　由于竞争的压力和对最佳战斗性能无止境的追求,军用航空电子从简单、独立的设备发展到如今以每秒百万位乃至更快的速度交换信息的高级智能系统网络。这也带来了必须克服的许多设计问题（见表1）。

　　根据 MIL-STD-1553 标准的规定,总线结构由三个不同的硬件组成：

　　● 总线控制器——总线控制器是总线上唯一允许在数据总线上发出命令,并负责引导数据总线中数据流的硬件设备。如果同时有几个终端可以实现总线控制器的功能,同一时间内只能有一个处于活动状态。
　　● 总线监视器——总线监视器是一个可以监控总线上信息交换的终端。它可以用于飞行测试记录、飞行故障诊断、维护记录与任务分析,同时还可作为一个备用总线控制器,它有足够的信息可以接替总线控制器。然而,总线监视器是一个被动的设备,它不能报告所传输信息的状态。
　　● 远程终端——每个远程终端都包括在数据总线和子系统间传输数据所必须的电子器件和支持性中间件。对于 MIL-STD-1553,子系统就是所传输数据的发送者和接收者。这些终端不能作为总线控制器或总线监视器使用。

　　MIL-STD-1553 系统实施

　　像其它军用网络技术一样,航空电子市场中的 MIL-STD-1553 测试和仿真实施也经历了从庞大的 DEC Unibus 卡到 19 英寸的通过机架安装的组件,又发展到用于 VME 和 PCI 系统上的较小、较为集成的多通道背板,现在又出现了更小、集成度更高的 PCMCIA 接口。图 2 描述了专用的 MIL-STD-1553 ASIC 芯片制造商的实施从离散的协议和收发器芯片组精简到单一的体积小、功耗低的 ASIC 的发展过程。

　　降低成本——由于实施了 FPGA 核心,生产和生命周期的成本会随着时间而下降。FPGA 价格历来是随着项目的进行而显著地下滑,而 ASIC 在长期的生产过程中价格却会上涨。很多航空电子系统已经在其设计中采用了 FPGA,一个 MIL-STD-1553 核心实例可以轻松地融入现有的芯片或同系列的其他更密集的芯片中。单一 FPGA 中集中了多通道实例可进一步节省成本,只因为单一 FPGA 内可以容纳多个通道接口。

　　便于重新编程——由于支持对现场硬件的重新编程,核心的实施显著降低了设计风险。如果系统需求发生变化,或者要修复一个错误时,基于 FPGA 的设计可以在软件的控制下进行升级。这种灵活性还可以在硬件构造完成后,在硬件和软件间重新区分功能。例如,如果在集成阶段发现软件不能有效地响应一个实时事件,可以将该功能下移到 FPGA 级别,这样就将原由软件实现的功能转化为硬件功能。

　　适应多种机体——灵活、可重新编程的解决方案适于为多种机体构架或针对多用途基础设计的飞航测试线上可更换件 (LRU)。由于 USAF和 NATO 的多种机体采用从 MIL-STD-1553B 标准分离出来的协议,所以多种机体的 LRU 需要灵活、可编程的设计。某些设计实施了通过特殊的子地址或模式代码协议进行寻址扩展的数据集。很多固定翼和可旋转翼飞机同时采用了较老的 MIL-STD-1553A 和 MIL-STD-1553B LRU,这就要求总线控制器和总线监视器能够处理不同的协议。

　　对 MIL-STD-1553 系统设计采用基于核心的实施

　　现代 FPGA 的强大功能使其成为 MIL-STD-1553 设计的理想选择,这就是 CONdor Engineering 推出 FlightCORE 的原因。FlightCORE 是一种允许设计人员在各种 Altera 和 Xilinx 的 FPGA中轻松实现无版权的实例化设计的 MIL-STD-1553 IP。多数情况下,利用Xilinx 综合技术 (XST) 或 Altera Quartus II 集成综合技术 (QIS),FlightCORE 1553 可以在两天内成功地集成。如图 4 所示,用户只须将 Condor Engineering 的 IP 核心与其自身逻辑和 Condor Engineering 的个别化模块 (3mm x 3mm) 集成,即可实现高性能的 MIL-STD-1553设计。FlightCORE 还允许开发人员选择存储器的大小以恰好地与其系统需求相匹配。图4还显示了可以实施内部存贮和/或外部双端口随机存贮器。该产品还提供了Manchester II编码与解码、信息协议验证与合法化及为接口控制和编程实施简单的共享存贮架构等所有的必要组件。只需增加外部收发器即可,如标准的COTS MIL-STD-1553或RS-485收发器。

　　单一芯片上集中多个实例

　　类似 Condor Engineering 的FlightCORE 这样的 MIL-STD-1553 解决方案需要少量的FPGA资源,约为 3,000个逻辑单元,148k bit的内存和不到 20个引脚（不包括外部主存总线）。较小的体积使在单一芯片上放置多个相互独立的实例成为可能,如图3 所示,某些程序可以在单一FPGA上集中8到10个实例。

　　结论

　　FPGA 与其容纳的“知识产权”使设计人员可以对 LRU 进行修改或专门设计,以适应不同的航空电子通信、武器系统和日新月异的升级之间的微小差异。像Condor Engineering的 MIL-STD-1553、1Mb和10Mb的FlightCORE IP 这样的通信核心,提供了一种直接而灵活的方法,可有效地解决日益增长的功能和废弃问题。

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