IP核使用集锦

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一、了解altpll（繁体中文）介紹
Cyclone™ FPGA具有鎖相迴路（PLL）和全局時鐘網，提供完整的時鐘管理方案。Cyclone PLL具有時鐘倍增和倍減、相位偏移、可編程佔空比和外部時鐘輸出，進行系統級的時鐘管理和偏移控制。Altera? Quartus? II軟體無需任何外部元件，就可以啟用Cyclone PLL和相關功能。本文將介紹如何設計和使用Cyclone PLL功能。
PLL常用於同步內部元件時鐘和外部時鐘，使內部工作的時鐘頻率比外部時鐘更高，時鐘延遲和時鐘偏移最小，減小或調整時鐘到輸出（TCO）和建立（TSU）時間。

使用Cyclone元件中的PLL
详细内容请见：http://www.eedesign.com.tw/article/Document/altera-9.htm#10


二、如何利用megawizard生成altpll（英语，有实例）

The altpll Megafunction User Guide offers two design examples that use the altpll megafunction to:
Generate an external differential clock from an enhanced PLL (as shown in Figure 1)
Generate and modify internal clock signals (as shown in Figure 2)
The following downloadable projects and files are used in this example:

详细情况可以到 http://www.altera.com.cn/support/examples/quartus/altpll.html 下载看到。
页面提供了详细的PDF文档与源程序。（手头紧的，可以去下载）